嵌入式MPEG4解码系统的设计(doc 6页)

1 系统设计原理
    系统设计包括硬件和软件。硬件主要分控制系统、MPEG-4解码系统、输入数据源三部分。数据源可以是IDE接口设备(如硬盘)或网络端口。控制系统对系统各部分进行监测和控制、完成数据流的传输等。如图1所示，它主要由主控芯片、Flash和SRAM组成。主控芯片通过PCI总线控制系统其他模块，是控制系统的核心；Flash里固化嵌入式Linux操作系统，存放应用软件和备份数据；SDRAM作为内存供系统运行使用。MPEG-4硬件解码系统采用硬解码方式，负责将输入的MPEG-4数据流解码成普通的电视信号，其核心是解码芯片。为解决数据流不稳定的问题，解码芯片通常使用SDRAM进行数据缓冲才可以保证正常解码过程，解码芯片的输出数字音频、视频数据还要经数模转换器(DAC)转换成模拟电视图像信号和声音信号。解码芯片通过I2C总线发送指令配置音、视频数模转换器。整个系统框图如图1所示。

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